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検索結果: 188 件

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  • インテル® Optane™ DC パーシステント・メモリー導入への道: その 3 – パーシステント・メモリーで C++ アプリケーションをブースト (簡単な grep の例)

    インテル® Optane™ DC パーシステント・メモリー導入への道: その 3 – パーシステント・メモリーで C++ アプリケーションをブースト (簡単な grep の例)

    2019年12月3日

    この記事は、インテル® デベロッパー・ゾーンに公開されている「Code Sample: Boost Your C++ Applications with Persistent Memory – A Simpl…
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  • インテル® Optane™ DC パーシステント・メモリー導入への道: その 2 – App Direct モードで不揮発性ディスクとして使用

    インテル® Optane™ DC パーシステント・メモリー導入への道: その 2 – App Direct モードで不揮発性ディスクとして使用

    2019年11月20日

    第 1 回ではインテル® Optane™ DC パーシステント・メモリー (DCPMM) の計画から装着までを説明しました。第 2 回では、App Direct モードで DCPMM を SSD のように不…
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  • インテル® Optane™ DC パーシステント・メモリー導入への道: その 1 – 計画から装着まで

    インテル® Optane™ DC パーシステント・メモリー導入への道: その 1 – 計画から装着まで

    2019年11月13日

    第 2 世代インテル® Xeon® スケーラブル・プロセッサーの発表に前後して、この新しい不揮発性メモリーの記事や資料をよく見かけるようになりました。iSUS では、今年導入した開発コード名 CascadeLake ベー…
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  • 32 ビット・インテル® アーキテクチャー上でデータ構造を調整してメモリー使用量を最適化する方法

    32 ビット・インテル® アーキテクチャー上でデータ構造を調整してメモリー使用量を最適化する方法

    2019年10月29日

    この記事は、インテル® デベロッパー・ゾーンに公開されている「How to Manipulate Data Structure to Optimize Memory Use on 32-Bit Intel® Archit…
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  • The Parallel Universe 38 号編集者からのメッセージ (抜粋)

    The Parallel Universe 38 号編集者からのメッセージ (抜粋)

    2019年10月22日

    この記事は、The Parallel Universe Magazine 38 号に掲載されている「Letter from the Editor」からの抜粋の日本語参考訳です。 Intel® HPC Developer …
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  • NUMA マイグレーションのパフォーマンスへの影響を測定

    NUMA マイグレーションのパフォーマンスへの影響を測定

    2019年9月17日

    この記事は、The Parallel Universe Magazine Issue 37 に掲載されている「Measuring the Impact of NUMA Migrations on Performance」…
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  • インテルの「One API」プロジェクトは、多様なアーキテクチャーに統合プログラミング・モデルを提供

    インテルの「One API」プロジェクトは、多様なアーキテクチャーに統合プログラミング・モデルを提供

    2019年8月14日

    この記事は、Intel Newsroom に公開されている「Intel’s ‘One API’ Project Delivers Unified Programming Model A…
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  • ループ・ブロッキングによる 32 ビットのインテル® アーキテクチャーのメモリー使用を最適化する方法

    ループ・ブロッキングによる 32 ビットのインテル® アーキテクチャーのメモリー使用を最適化する方法

    2019年8月7日

    この記事は、インテル® デベロッパー・ゾーンに公開されている「How to Use Loop Blocking to Optimize Memory Use on 32-Bit Intel® Architecture」の…
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  • ハイパフォーマンス静音ワークステーションを自作する

    ハイパフォーマンス静音ワークステーションを自作する

    2019年7月30日

    これまで iSUS 編集部では、いくつかのハイパフォーマンス自作シリーズを紹介してきました。 編集長の夏休みの工作 パート 2 (Micro ATX での Xeon Phi マシン の組立て) 編集長の夏休みの工作 (X…
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  • 第 2 世代インテル® Xeon® スケーラブル・プロセッサーの技術概要

    第 2 世代インテル® Xeon® スケーラブル・プロセッサーの技術概要

    2019年5月10日

    この記事は、インテル® デベロッパー・ゾーンに掲載されている「Second Generation Intel® Xeon® Processor Scalable Family Technical Overview」の日本…
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  • インテル® コンパイラーの最適化オプションから見る次世代 CPU

    インテル® コンパイラーの最適化オプションから見る次世代 CPU

    2019年5月8日

    さまざまな PC 系記事サイトで今後登場する CPU (Cannonlake✝、Icelake✝、などなど) の新機能が取り上げられていますが、発表前のプロセッサーであるため噂の域を出ません… しかし、サポートされる命令…
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  • インテル® 64 および IA-32 アーキテクチャー最適化リファレンス・マニュアル – 248966-041 April 2019 で追加された第 11 章 インテル® Optane™ DC パーシステント・メモリーの参考訳

    インテル® 64 および IA-32 アーキテクチャー最適化リファレンス・マニュアル – 248966-041 April 2019 で追加された第 11 章 インテル® Optane™ DC パーシステント・メモリーの参考訳

    2019年5月3日

    この記事は、インテル® デベロッパー・ゾーンに掲載されている「Intel® 64 and IA-32 Architectures Optimization Reference Manual」ドキュメント番号: 24896…
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  • インテル® 64 および IA-32 アーキテクチャー最適化リファレンス・マニュアル – 248966-041 April 2019 で追加された第 7 章 INT8 ディープラーニング推論の参考訳

    インテル® 64 および IA-32 アーキテクチャー最適化リファレンス・マニュアル – 248966-041 April 2019 で追加された第 7 章 INT8 ディープラーニング推論の参考訳

    2019年4月27日

    この記事は、インテル® デベロッパー・ゾーンに掲載されている「Intel® 64 and IA-32 Architectures Optimization Reference Manual」ドキュメント番号: 24896…
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  • Hot Chips におけるヘテロジニアス時代の前触れ

    Hot Chips におけるヘテロジニアス時代の前触れ

    2019年4月18日

    この記事は、インテル® デベロッパー・ゾーンに公開されている「Hot Chips Heralds Heterogeneity」 (https://systemdesign.intel.com/hot-chips-hera…
    続きを読む

  • プログラミング、リファクタリング、そしてすべてにおける究極の疑問: まとめ

    プログラミング、リファクタリング、そしてすべてにおける究極の疑問: まとめ

    2019年3月19日

    この記事は、インテル® デベロッパー・ゾーンに公開されている「The Ultimate Question of Programming, Refactoring, and Everything」の日本語参考訳です。 まと…
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